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在FPGA中a-b为负数会怎样?

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  • TA的每日心情
    郁闷
    7 天前
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    发表于 2018-6-7 17:15:10 | 显示全部楼层 |阅读模式
    在FPGA中对AD采样数据进行处理,怎么样恢复成原始数据?每个周期有10个采样点。还有在FPGA中a-b为负数会怎样?

    系列一为采样出来的数据;系列三为处理以后的数据,系列四位系列三减系列四 ...

    系列一为采样出来的数据;系列三为处理以后的数据,系列四位系列三减系列四 ...

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  • TA的每日心情
    萌哒
    2018-5-29 11:59
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    发表于 2018-6-7 18:58:52 | 显示全部楼层
    第一个问题没看懂。
    第二个问题,负数也是数,比如16'd0-16'd1就是16'hffff
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  • TA的每日心情
    萌哒
    2018-5-29 11:59
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    发表于 2018-6-7 18:59:48 | 显示全部楼层
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  • TA的每日心情
    郁闷
    7 天前
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     楼主| 发表于 2018-6-8 08:31:27 | 显示全部楼层
    admin 发表于 2018-6-7 18:58
    第一个问题没看懂。
    第二个问题,负数也是数,比如16'd0-16'd1就是16'hffff

    嗯,谢谢,第二个和我想的一样。第一个问题是用50MHz的频率AD对5MHz为1bit的信号进行采集,得到原始信号系列一,然后怎么恢复成周期为5MHz的数字信号。阈值判断行不通,最重要的是怎样判断每bit信号从哪开始。
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