【7606C】【并行】【软件模式】修订记录

makabaka

20250731修订：
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720-V3串口FIFO： acx720_v3_uart_ad7606c_fifo_parallel（0731修订）.zip (103.47 KB, 下载次数: 121)

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720-V3串口DDR： acx720_v3_uart_ad7606c_drr_parallel（0731修订）.zip (610.44 KB, 下载次数: 139)

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部分程序下板实测，出现波形峰峰值减半情况，这是因为原来驱动里面无条件全局大复位之后没有进行初始化寄存器表操作，导致通道采样范围默认±10V。本次修改添加Frist_wr_soft信号作为全局复位后进行一次初始化寄存器表的指示信号，这个信号默认为1，然后在大复位之后进行判断它的值，此时还是为1的状态，那么就会进入03状态开始初始化寄存器表；在进入到03状态后将它置0；之后他就会处于无效状态；