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【智多晶SA5Z FPGA BSP SDK】支持 FreeRTOS，重构驱动与多种组件	智多晶	Joris-Lee 2024-9-13	01638	Joris-Lee 2024-9-13 17:00
ZYNQ ADC数据采集，DDR缓存进行数据缓存，并利用网口数据上传，但是出现数据撕裂问题	Xilinx Vivado 开发板	dyc123 2024-9-13	11099	tb一下 2024-9-13 15:16
Vivado软件字体大小设置	Vivado软件使用和设置	tb一下 2024-9-13	02084	tb一下 2024-9-13 09:57
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【产品资料】【扩展模块】ACFL3014 USB3.0模块资料	产品资料	故梦 2024-9-11	12110	故梦 2024-9-11 14:23
如何使用AXI4接口对PLL/MMCM输出时钟的频率和相位进行动态重配置	Xilinx Vivado 开发板	tb一下 2024-9-2	12483	tb一下 2024-9-2 14:11
【AC820-ZYNQ】出厂固件烧录	AC820-ZYNQ开发板	hackersheng 2024-8-30	01724	hackersheng 2024-8-30 14:44
【AC608-7Z010】UBoot下使用网口TFTP更新内核镜像	AC608-ZYNQ邮票孔核心板	hackersheng 2024-8-30	01644	hackersheng 2024-8-30 11:20
FPGA 后仿真端口问题	Modelsim编译报错	lipeng 2024-8-28	01224	lipeng 2024-8-28 21:47
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【AC820】AD9238数据采集DDR3缓存千兆以太网发送实验	AC820-ZYNQ开发板	ruoyuguize 2024-8-27	02968	ruoyuguize 2024-8-27 10:48
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axi4_to_fifo模块中读DDR3请求信号的产生条件	Xilinx Vivado 开发板	tb一下 2024-8-21	01330	tb一下 2024-8-21 16:24
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【AC6103】ACM1030数据采集FIFO缓存千兆以太网发送实验	AC6102教学开发版	故梦 2024-7-19	01257	故梦 2024-7-19 10:05
如何打开一个获得的ZYNQ的裸机SDK实例工程并本地编译和调试运行	ACZ702开发板	admin 2024-7-17	02613	admin 2024-7-17 21:51
【安路】【TD】如何修改TD工程名	安路	手撕原子弹 2024-7-17	01444	手撕原子弹 2024-7-17 11:14
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