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【产品资料】【扩展模块】ACM68013 USB2.0模块资料和使用说明	admin 2021-5-19	511913	admin 2023-12-1 17:17
verilog语法中信号位宽常见问题解析	商震 2021-8-6	46497	商震 2021-8-26 15:34
FPGA逻辑工程涉及以太网的实验配置要点及注意事项	商震 2021-8-6	23660	admin 2024-3-29 13:51
【设计实例】B盘 04 数据采集传输系统设计与实现课程源码	admin 2021-3-16	24264	wwj862617578 2022-2-20 20:42
Altera的Quartus II中DDR2 IP仿真问题与解决方案	admin 2021-2-14	26265	xiaoxiao 2021-2-15 12:14
<=小于等于和非阻塞赋值号在verilog代码中如何区分？	商震 2021-8-6	14686	admin 2021-11-12 16:50
基于AC620的串口传图显示程序分享	2016210117 2021-4-25	12935	admin 2021-4-25 21:55
【设计实例】加入读写FIFO的双端口DDR2 控制器仿真测试	admin 2021-2-16	06538	admin 2021-2-16 11:57
Nios II Software Build Tools for Eclipse打开出错	舒俊 2021-7-2	03934	舒俊 2021-7-2 15:58
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仿真描述了各信号，却连时钟都没有输出的一种可能	商震 2021-7-23	02244	商震 2021-7-23 18:20
【实验说明】基于PCF8563 RTC案例日期显示异常原因及解决方法	商震 2022-2-8	03159	商震 2022-2-8 17:00
mif精灵生成的coe文件报错无法导入rom	商震 2021-3-26	06988	商震 2021-3-26 11:35
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Testbench中使用@（posedge xxx）语法时易出现的问题和原因	商震 2021-8-31	03021	商震 2021-8-31 18:29
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